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可以定义一个5BIT变量上标符号位为0的函数 (1.2.8) 同理可得： (1.2.9) 由此可以得到： (1.2.10) 令 ，可以推出： (1.2.11) 从上述公式中可以看出，用5 * 1 8位乘法器可以在8个时钟周期达到上面的公式。 作为FPGA接口上的A/D器件的转换数据输入寄存器，将寄存器内的数据和各自的系数的最高位相乘，送入累加器中相加，最后将其和向左移一位，以实现乘2运算。对于下一个时钟，重复以上的步骤，对于接下的6个时钟
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符号位,因此可以定义一个5bit为变量的函数F为:F(xk.,z:一l,x12,ylI,y曼2)＝aox:+口lx。k—l+口2x12+60y量1+blyl2(5)由此可以得到:Y。＝∑2＿F(a:,a:,口:k,6:,6÷)一F(a:,ao,臼:0,6:,衅)k＝l(6)令,(以:,口?,口20,bo,卵)＝0,可以推出:b-IY。＝∑2一F(ako,口?,口:k,bg,67) (7)k＝l从式(7)中可以看出,可以用一个五路8位堆1位乘法器在8个时钟周期内实现上述算式。其加法可以直接调用软件的库实现。本方案实现结构如图巴2所示。图2改进型实现框图图2中的Xf刀)作为FPGA接口上的A／D器件的转换数据输入寄存器,各寄存器内的数据与各自的系数的最高位相乘后,送入累加器相加
符号位,因此可以定义一个5bit为变量的函数F为:F(xk.,z:一l,x12,ylI,y曼2)＝aox:+口lx。k—l+口2x12+60y量1+blyl2(5)由此可以得到:Y。＝∑2＿F(a:,a:,口:k,6:,6÷)一F(a:,ao,臼:0,6:,衅)k＝l(6)令,(以:,口?,口20,bo,卵)＝0,可以推出:b-IY。＝∑2一F(ako,口?,口:k,bg,67) (7)k＝l从式(7)中可以看出,可以用一个五路8位堆1位乘法器在8个时钟周期内实现上述算式。其加法可以直接调用软件的库实现。本方案实现结构如图巴2所示。图2改进型实现框图图2中的Xf刀)作为FPGA接口上的A／D器件的转换数据输入寄存器,各寄存器内的数据与各自的系数的最高位相乘后,送入累加器相加
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